Blog of George Lin

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Makefile

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Posted by George Lin on December 17, 2025

手撕代码

宝鼎茶闲烟尚绿,幽窗棋罢指犹凉

以下内容参考自多平台，如有侵权，联系删除 二进制vs格雷码转换 部分内容搬运自🔥🗓手撕代码：二进制vs格雷码转换 - 小红书 核心问题：为什么二进制移位异或之后，就会变成只有1bit会发生变化的格雷码？ 简答：异或记录的不是数字本身，而是数字变化的边界。核心是比如4b0111加一变成4b1000，后面三位中每连续的两位都是一致的，异或出来的结果也是一致的，只有到了变化边界这里，才会出...

Posted by George Lin on December 1, 2025

时钟门控

淡极始知花更艳，愁多焉得玉无痕

以下内容全部来自(71 封私信 / 80 条消息) 芯片设计进阶之路——门控时钟 - 知乎 门控时钟 芯片功耗组成中，有高达40%甚至更多是由时钟树消耗掉的。这个结果的原因也很直观，因为这些时钟树在系统中具有最高的切换频率，而且有很多时钟buffer，而且为了最小化时钟延时，它们通常具有很高的驱动强度。此外，即使输入和输出保持不变，接收时钟的触发器也会消耗一定的功耗。而且这些功耗主要是动...

Posted by George Lin on November 30, 2025

Workflow Optimization

日常工作流优化

行之有效的PDF转换方法 去密码：foxin PDF converter (pdf365) 去水印：foxin PDF converter (pdf365) 改元数据：Officebox万彩办公大师-PDF文件批量重命名

Posted by George Lin on August 10, 2025

AI是实习生而非队友

个人对于AI在工作流中扮演角色的思考

一直困惑AI在工作流中的角色定位，今天看到一个很有意思的观点，认为我们应该把AI当成一个实习生来看待，深表赞同，故此mark一下。（from @Sophia潘潘） 一个实习生能为团队带来的收益是什么？ 首先是基础工作的分担。这里的基础工作我认为包括：1. 耗时但重复性的工作。2. 项目中相对边缘的工作（即：与项目叙事本身偏离较大的必要性工作）。3. 项目初期预研工作（收集、整理文献）。我...

Posted by George Lin on July 31, 2025

ACE

ACE

ACE学习系列博客目录 ACE学习系列-01-从AXI到ACE:多核系统一致性的必然选择 - George Lin’s Blog ACE学习系列-02-ACE缓存一致性模型：五状态机的设计哲学 - George Lin’s Blog ACE学习系列-03-ACE事务类型体系：从信号到语义的映射 - George Lin’s Blog ACE学习系列-04-Snoop机制：ACE一致性...

Posted by George Lin on May 30, 2025

DRAM

DRAM

DRAM Typical Read/Write Speed: 17ns （3000x faster than SSD） SSD Typical Read/Write Speed: 50us DRAM limited to 2-D arrays ~16G SSD 3D-arrays ~2T every 64ms refresh one time. each refresh takes ...

Posted by George Lin on May 30, 2025

Spyglass

Spyglass

https://www.bilibili.com/video/BV1cj411i7zf?spm_id_from=333.788.player.switch&vd_source=6bdb3504029acf6961e3195b9ad841b9 VC Spyglass 工具Lint检查默认使用的方法学说明位置 VC_STATIC_HOME/auxx/monet/tcl/GuideWa...

Posted by George Lin on May 17, 2025

Watchdog

Watchdog

Watchdog Timer（看门狗） 看门狗定时器（WDT，Watch Dog Timer）是单片机的一个组成部分，本质是一个递增（或者递减）的定时器，程序开始执行的时候，看门狗的值就开始递增或者由某固定值递减，到达设定的值的时候单片机就触发中断或者产生系统复位，重新运行。是用来监测单片机运行状态和解决程序引起的故障的模块 防止系统跑飞 看门狗可用于受到电气噪音、电源故障、静电放电等...

Posted by George Lin on May 12, 2025

Verilog

Verilog

bufif1 (Verilog Primitive) buf buf g(out, in) The buffer (buf) passes input to the output as it is. It has only one scalar input and one or more scalar outputs. ...

Posted by George Lin on May 12, 2025

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